アルデックがDVCon中国2017でハードウェア・イン・ザ・ループとQEMUを利用した設計検証技術を展示

（上海）- （ビジネスワイヤ）--ASICおよびFPGA設計向け混合HDL言語シミュレーションおよびハードウェア支援検証の先駆的企業のアルデックは、2017年4月19日に中国・上海で開催されるDVCon中国大会でハードウェア・イン・ザ・ループを使用したASICプレシリコン検証スペクトラムを展示します。

アルデックのハードウェア検証商品マネージャーのKrzysztof Szczurは、このように述べています。「今年の最初の四半期は、アルデックの研究開発において多忙で生産的な時期となりました。最大のXilinx® Virtex® UltraScale™ FPGAに基づいた新たなHESボードをリリースしてDVCon米国で展示しただけでなく、QEMUおよびRiviera-PROのハードウェア／ソフトウェア協調シミュレーションのためのQEMUブリッジを設計し、それをドイツのエンベデッドワールドで披露した際には、好意的な反応をいただくことができました。次の自然なステップは、この2つの製品を組み合わせ、QEMUとアルデックHESボードをつなげるハードウェア・イン・ザ・ループを利用したハードウェア／ソフトウェア協調検証環境を提供することでした。その成果を、上海で行われるDVCon中国で自信を持って展示いたします。」

QEMUおよびHES-DVMによるハイブリッド協調エミュレーション

SoC ASICの検証と検定には、信頼性の高いハードウェア／ソフトウェア協調検証の技術が不可欠です。QEMUは汎用性のあるオープンソースのマシン・エミュレーターであり、ARM® Cortex®ファミリーを含む多様なコンピューター・ハードウェアのアーキテクチャーをサポートしています。これは、アルデックのHES-DVM™エミュレーション・プラットフォームと接続することができ、SoC ASIC設計のための完全なハイブリッド協調エミュレーション環境を提供します。

HES-DVMは、合成可能SystemVerilogあるいはVHDLで書かれた設計のあらゆる部分をエミュレートでき、特定のSoCの独自機能を実装する自社SoCサブシステムのカスタム設計で特によく利用されています。それに対して、汎用演算サブシステム（CPU）はハードIPやネットリスト・ファイルとしてサードパーティーのベンダーから調達されることが多く、RTLコードは入手できません。QEMUは、このような標準的なコンポーネントをエミュレートし、組み込みファームウェアやソフトウェアのテストを実行するために使用されます。今ではHES-DVMプラットフォームとの接続が簡単になり、すべてのSoCサブシステムを一緒に検証できるようになっています。このアプローチでは、ハードウェアとソフトウェアの両方について設計検証の徹底と包括性が保証され、ダミー・パッチを適用する必要はなく、不完全な設計のためにデバイスドライバーやファームウェアのコードを損なうこともありません。

UVMシミュレーション高速化

アルデックのHDLシミュレーションにおける33年間の経験と最新のSoC設計／検証時の要求についての深い理解により、アルデックの高性能HDLシミュレーターであるRiviera-PRO™を開発する道が拓けました。UVM、SystemVerilog、OSVVM、VHDL-2008、TLM/SystemCに対応しています。Riviera-PROとハードウェア・イン・ザ・ループでは、シミュレーションの2桁の高速化も可能になっています。DVCon中国で展示される実動デモでは、130倍を超えるシミュレーションの高速化を達成する方法を実演します。アルデックのHES™ FPGAボード上で動くネットワーク・オン・チップ（NoC）設計を実例として使用し、トランザクション・レベルのUVM TestbenchをRiviera-PROで実行します。

アルデックについて

ネバダ州ヘンダーソンに本社を置くアルデックは、エレクトロニクス・デザイン検証の業界リーダーです。RTL設計、RTLシミュレーター、ハードウエア支援検証、SoCおよびASICプロトタイピング、設計ルールチェック、CDC検証、IPコア、要求ライフサイクル管理、DO-254機能検証、組み込みソリューション、軍事／航空宇宙向けソリューションなどで、特許を取得した技術スイートを提供しています。www.aldec.com

Aldecはアルデックの登録商標です。その他全ての商標または登録商標は各所有者に帰属します。

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